為更好的解決薄膜電容頻率高，總線(xiàn)周期特別快的情況，為增加系統(tǒng)的抗電磁干擾能力采取如下措施：

1、減小信號(hào)傳輸中的畸變：

微控制器主要采用高速CMOS技術(shù)制造。信號(hào)輸入端靜態(tài)輸入電流在1mA左右，輸入電容10PF左右，輸入阻抗相當(dāng)高，高速CMOS電路的輸出端都有相當(dāng)?shù)膸лd能力，即相當(dāng)大的輸出值，將一個(gè)門(mén)的輸出端通過(guò)一段很長(zhǎng)線(xiàn)引到輸入阻抗相當(dāng)高的輸入端，反射問(wèn)題就很?chē)?yán)重，它會(huì)引起信號(hào)畸變，增加系統(tǒng)噪聲。當(dāng)Tpd＞Tr時(shí)，就成了一個(gè)傳輸線(xiàn)問(wèn)題，必須考慮信號(hào)反射，阻抗匹配等問(wèn)題。瓷谷電子認(rèn)為，信號(hào)在印制板上的延遲時(shí)間與引線(xiàn)的特性阻抗有關(guān)，即與印制線(xiàn)路板材料的介電常數(shù)有關(guān)?？梢源致缘卣J(rèn)為，信號(hào)在印制板引線(xiàn)的傳輸速度，約為光速的1/3到1/2之間。微控制器構(gòu)成的系統(tǒng)中常用邏輯電話(huà)元件的Tr（標(biāo)準(zhǔn)延遲時(shí)間）為3到18ns之間。

當(dāng)信號(hào)的上升時(shí)間快于信號(hào)延遲時(shí)間，就要按照快電子學(xué)處理。溥膜電容廠家認(rèn)為此時(shí)要考慮傳輸線(xiàn)的阻抗匹配，對(duì)于一塊印刷線(xiàn)路板上的集成塊之間的信號(hào)傳輸，要避免出現(xiàn)Td＞Trd的情況，印刷線(xiàn)路板越大系統(tǒng)的速度就越不能太快。

2、選用頻率低的微控制器：

選用外時(shí)鐘頻率低的微控制器可以有效降低噪聲和提高系統(tǒng)的抗干擾能力。同樣頻率的方波和正弦波，方波中的高頻成份比正弦波多得多。雖然方波的高頻成份的波的幅度，比基波小，但頻率越高越容易發(fā)射出成為噪聲源，微控制器產(chǎn)生的最有影響的高頻噪聲大約是時(shí)鐘頻率的3倍。